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Hatfield Risc Processor — Wikipedia

Source: Wikipedia (it)
Original: https://it.wikipedia.org/wiki/Hatfield_Risc_Processor
License (as archived): CC-BY-SA-4.0
Archived: 2026-11-05T20:19:49.683Z
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Hatfield Risc Processor — Wikipedia — Wikipedia (it), https://it.wikipedia.org/wiki/Hatfield_Risc_Processor (CC-BY-SA-4.0); archived copy: https://metraipolis.com/documento/dc_c7ca18efcd7e (Metraipolis archive dc_c7ca18efcd7e, sha256 bd08e257470118ff3d9865d19c0c3f61ad3f45796cad7a30714b83252da4d2b1)

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HARP (HAtfield Risc Processor) era un microprocessore sviluppato a scopo di ricerca dal Politecnico Hatfield (University of Hertfordshire) all'inizio degli anni novanta. Il processore era caratterizzato da un'architettura Very long instruction word (legge blocchi di 128 bit formati da 4 istruzioni da 32 bit) e dall'esecuzione di tutte le istruzioni in modalità predicativa al fine di ridurre i salti condizionati e quindi migliorare il parallelismo. Il progetto prevedeva lo sviluppo anche di un apposito compilatore che ottimizzasse il codice. L'obiettivo del progetto era sviluppare un processore in grado di eseguire più di un'istruzione per ogni ciclo di clock durante l'esecuzione di codice generico. Al fine di minimizzare i tempi di attesa dovuti ai salti condizionati il compilatore fa una previsione statica sull'effettiva esecuzione del salto e provvede a far eseguire al processore l'istruzione successiva al salto. Nel caso in cui la previsione di salto si dimostri errata, il processore autonomamente provvede a eliminare l'istruzione eseguita. Il processore è dotato di quattro pipeline a quattro stadi; al fine di ridurre il numero di transistor utilizzati, le quattro pipeline non sono in grado di eseguire tutte le istruzioni: solo la prima è in grado di eseguire alcune istruzioni considerate non comuni. L'architettura segue il paradigma load/store, in cui ogni istruzione attende due registri di ingresso e un registro di uscita per i dati elaborati. Il processore è dotato di 32 registri ad uso comune. La presenza di quattro pipeline parallele rendeva molto oneroso realizzare registri in grado di fornire e accettare dati da tutte le pipeline contemporaneamente. Il processore prevede che solo due pipeline possano scrivere nei registri per ogni ciclo di clock. Per evitare di bloccare costantemente le pipeline in attesa delle scritture, il sistema prevede dei registri temporanei dove salvare i risultati in attesa di poterli scrivere nei registri generali. Il processore permette il trasferimento dei risultati prima del loro effettivo salvataggio nei registri temporanei (writeback) e fornisce dei bit appositi per gestire la coerenza tra le istruzioni.

Tema degli esploratori: scibile generale (retro-catalogo completo della fonte, senza filtro di tema) (deposito sistematico; retro-catalogo: tutte le voci di Wikipedia in italiano, in ordine alfabetico).
Fonte: Wikipedia in italiano, voce «Hatfield Risc Processor» — https://it.wikipedia.org/wiki/Hatfield_Risc_Processor
Wikidata Q3783642 (dati Wikidata in CC0 1.0) — https://www.wikidata.org/wiki/Q3783642
Autori: i contributori di Wikipedia (cronologia: https://it.wikipedia.org/wiki/Hatfield_Risc_Processor?action=history).
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